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SiTCPに関する情報を共有するためのフォーラムです。この目的に反しない範囲で、質問、コメント、回答などご自由にご投稿ください。
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比較的古いWindows10 PC（ 64bit、CPU：Corei5-4200U、メモリ：6GB）で以下の(1)(2)を確認してみました。 (1)Vivado他バージョンのインストールの有無 ⇒このPCにはVivado2019.2とVivado2021.2をインストールされていましたが、2021.2で「SiTCP_Sample_Code_for_VC7…
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ご連絡ありがとうございます。 依然として弊社の環境で再現できていないのですが、SiTCPで合成出来ずSiTCPXGで合成できるとのことですので、度々お手数をおかけしますが、SiTCPのライブラリ（ネットリスト）のファイル形式をngcからedifへ変換することを試してみてい…
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念のため[Number of jobs]の2または1への設定も試してみてください。
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「WRAP_gig_ethernet_pcs_pma_0」モジュール等、モジュールのどれかをコメントアウトすることで合成できるかを確認していただいてもよろしいでしょうか。 また、同じPCで他のサンプルコード（例えば https://github.com/BeeBeansTechnologies/SiTCP_Sample_Code_for_…
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先程こちらの環境でログを確認したところ、コピーしていただいたメッセージの次に来るのが以下です Release 14.7 - ngc2edif P_INT.20191124 (nt64) Copyright (c) 1995-2013 Xilinx, Inc. All rights reserved. Reading design fifo_generator_v11_0.ngc ... W…
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「Vivado Jobs: 8」とのことですが、これを4または2にして試してみていただけますか？ こちらで試した環境は以下の通りですが、bitファイルの生成まで10分～15分程度で完了します。 OS: Windows10 64bits CPU: Intel Core i7-3770 RAM: 24GB Vivado version: 2021…
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弊社でもWindows10 PC(64bit)上のVivado 2021.2で上記ソースコードを使用して試してみましたが、bitファイルの生成まで行うことが出来ました。 GUI上で[Run Synthesis]や[Generate Bitstream]をクリックすると[Launch Runs]の表示が出ますが、[Number of jobs]の数を…
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ドキュメント中の5.1.の内容ですが、生成したIPのソースディレクトリ（ip\ten_gig_eth_pcs_pma_0\synth）の中にある「ten_gig_eth_pcs_pma_0_block.v」に記述されている当該信号のwire定義文で、0を1に書き換えるというものです。
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IPの極性とはどの信号の極性なのでしょうか。 KC705の基板バージョンに関わる修正（https://github.com/BeeBeansTechnologies/SiTCPXG_Sample_Code_for_KC705/blob/master/KC705_SiTCP_XG_EEPROM.pdf のP9に記載されているもの）とは異なりますか？
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「vc707 のSiTCPのサンプルコードを改変したもの」をお使いになっているとのお話ですが、 通信不具合の起こっている基板に対して、サンプルコードから生成したbitファイル（またはmcsファイル）を 書き込んでも同様の通信不具合が起きるのでしょうか。 ご確認いただ…